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崗位職責(zé)： 1.負(fù)責(zé)模擬電路的設(shè)計(jì)、仿真、驗(yàn)證等工作； 2.負(fù)責(zé)評(píng)估工藝，并提出工藝需求； 3.指導(dǎo)版圖設(shè)計(jì)工程師完成模擬電路版圖設(shè)計(jì)； 4.配合測(cè)試工程師完成電路測(cè)試； 任職要求： 1. 本科5年、碩士3年及以上工作經(jīng)驗(yàn)； 2. 有模擬電路相關(guān)的設(shè)計(jì)開(kāi)發(fā)經(jīng)驗(yàn)，參與過(guò)完整的產(chǎn)品開(kāi)發(fā)及流片、導(dǎo)入流程； 3. 熟悉Linux操作系統(tǒng)，熟練使用Candence等IC設(shè)計(jì)軟件，熟悉Spectre、Hspice、hsim等仿真工具；熟練使用Cadence軟件進(jìn)行模擬IC設(shè)計(jì)/仿真和設(shè)計(jì)規(guī)則檢查； 4.對(duì)芯片中常用模塊有深入理解，如ADC、Driver、OPA、DAC、Bandgap等； 5.對(duì)工藝、器件有一定認(rèn)識(shí)； 6. 具有數(shù)模混合電路設(shè)計(jì)基礎(chǔ)，能使用Verilog/Verilog-A； 7．具有l(wèi)ed線性驅(qū)動(dòng)、ACDC、DCDC等成功設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮 五險(xiǎn)一金 員工旅游 專業(yè)培訓(xùn) 彈性工作 績(jī)效獎(jiǎng)金 年終獎(jiǎng)金 周末雙休職責(zé)描述：